AD6620ASZ

Ricevitore digitale AD6620 con quattro elementi processori di segnale in cascata: un traslatore di frequenza, due filtri decimatori a coefficiente fisso e un filtro a coefficiente programmabile. Tutti gli ingressi sono compatibili con LVCMOS di 3,3V. Tutte le uscite sono compatibile con LVCMOS e TTL di 5V. Man mano che gli ADC raggiungono un range dinamico e velocità di campionamento più elevate, compiere lo stadio IF finale di un ricevitore nel dominio digitale diventa sempre più interessante. L'elaborazione IF digitale è meno costoso, più facile da produrre, più accurato e più flessibile di uno stadio analogico altamente selettivo simile. Questo ricevitore decimatore di canali in diversità è pensato per costituire il bridge tra gli ADC ad alta velocità e i DSP a scopo generico. L'NCO ad alta risoluzione permette di selezionare un singolo carrier da uno stream di dati ad alta velocità. I filtri decimatori ad alto range dinamico con ampio range di velocità di decimazione permettono di estrarre carrier sia a banda stretta che a banda larga.

• Alta velocità di campionamento di ingresso, traslazione di frequenza NCO
• Fase lineare con filtro FIR CIC (cascaded integrator comb) del secondo ordine, coefficienti fissi
• Fase lineare con filtro FIR CIC (cascaded integrator comb) del quinto ordine, coefficienti fissi
• Filtro FIR di coefficiente di RAM decimatore programmabile
• Circuiteria di sincronizzazione bidirezionale, la fase allinea gli NCO
• Sincronizza i clock di uscita dati; uscite di banda base seriali e parallele; seriale/parallela selezionabile da pin
• Porta parallela a 16bit; uscite I e Q interlacciate; due porte di configurazione e controllo separate
• Porta µP generica, porta seriale, scansione dei boundary JTAG
• Compatibilità logica tipica: CMOS 3,3V
• Package PQFP a 80 piedini, temperatura di ambiente: da -40 a +85°C

Note

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