AD9680BCPZ-1000

AD9680 è un convertitore analogico-digitale (ADC) duale a 14bit e 1GSPS. I due core dell'ADC è caratterizzato da un'architettura pipeline differenziale multistadio con logica di correzione degli errori di output integrata. Ogni ADC è dotato anche di ingressi a banda larga che supportano una varietà di range di ingresso selezionabili dall'utente. Un riferimento di tensione integrato facilita le considerazioni di design. L'ingresso analogico e i segnali di clock sono input differenziali. Ogni uscita di dati dell'ADC è connessa internamente a due downconverter digitali (DDC). Ogni DDC è costituito da fino a cinque stadi di elaborazione dei segnali in cascata: un traslatore di frequenza a 12bit e quattro filtri di decimazione a mezza banda. I DDC sono bypassati di default. Le applicazioni tipiche includono: comunicazioni, multi banda in diversità, ricevitori digitali multimodali (3G/4G, TD-SCDMA, W-CDMA, GSM, LTE), radio software a scopo generico, ricevitori satellitari a ultra banda larga, strumentazioni, radar, Signals Intelligence (SIGINT), path di ricezione in upstream CMTS DOCSIS 3.0 e ricevitori reverse path digitali HFC.

• Funzionamento con alimentazione DC di 1,25V, 2,5V e 3,3V
• Senza codici mancanti, riferimento di tensione di ADC interno
• Range di ingresso flessibile: da 1,7V p-p nominale
• Larghezza di banda a piena potenza di input analogico utilizzabile: 2GHz
• Isolamento canale/crosstalk 95dB; bit di rilevamento di ampiezza per implementazione efficiente del controllo AGC
• Input di clock differenziale, divisore di clock per interi di 1, 2, 4 o 8 e dither dei piccoli segnali
• DNL = ±0,5LSB, INL = ±2,5LSB, densità di rumore = -154dBFS/Hz a 1GSPS
• ENOB: 10,8bit a 10MHz
• SNR: 67,2dBFS e 67,1dBFS a fIN = 10MHz
• Package LFCSP-EP a 64 piedini, range di temperatura esercizio: da -40°C a 85°C

Note

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