AD9648BCPZ-125

AD9648 è un ADC monolitico a 2 canali da 14bit e 125MSPS. Questo ADC contiene diverse funzioni pensate per massimizzare la flessibilità e ridurre il costo del sistema, come l'allineamento di dati e clock programmabile e la generazione di pattern di test digitali programmabile. I pattern di test digitali disponibili includono pattern deterministici e pseudo-random integrati, oltre ai pattern di test personalizzati definiti dall'utente inseriti attraverso l'interfaccia SPI. Un input di clock differenziale controlla tutti i cicli di conversione interni. Uno stabilizzatore di duty cycle (DCS) opzionale compensa le ampie variazioni nel duty cycle del clock e mantiene eccellenti allo stesso tempo le prestazioni complessive dell'ADC. Le applicazioni tipiche includono: comunicazioni, sistemi radio in diversità d'antenna, ricevitori digitali multimodali (3G), (GSM, EDGE, W-CDMA, LTE, CDMA2000, WiMAX, TD-SCDMA), sistemi di demodulazione I/Q, sistemi smart antenna, applicazioni di dati in broadband, strumenti a batteria, ScopeMeter palmari, imaging medicale e a ultrasuoni portatile, radar/LIDAR.

• Alimentazione analogica: 1,8V
• Alimentazione di output CMOS: 1,8V-3,3V o alimentazione di output LVDS 1,8V
• SNR = 74,5dBFS a 70MHz ed SFDR = 91dBc a 70MHz
• Ingresso analogico differenziale con larghezza di banda 650MHz e frequenze di campionamento IF fino a 200MHz
• Riferimento di tensione e circuito sample-and-hold incorporati; input analogico differenziale p-p di 2V
• Formato dati: Offset binario, codice Grey o complemento a due, stabilizzatore di duty cycle del clock opzionale
• Divisore di clock di ingresso da 1 a 8 interi; opzione di multiplex di output dati
• Generazione di pattern di test digitale selezionabile incorporata; modalità di power-down a risparmio energetico
• Data Clock out con allineamento di dati e clock programmabile
• Package LFCSP-VQ-EP a 64 piedini, range di temperatura di esercizio: da -40°C a 85°C

Note

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