AD9643BCPZ-170

AD9643BCPZ-170 è un doppio convertitore analogico-digitale (ADC) da 1,8V a 170MSPS. È progettato per supportare le applicazioni di comunicazione, dove si richiedono basso costo, piccole dimensioni, banda larga e versatilità. I due core dell'ADC sono caratterizzati da un'architettura pipeline differenziale multistadio con logica di correzione degli errori di uscita integrata. Ogni ADC è dotato anche di ingressi a banda larga che supportano una varietà di range di ingresso selezionabili dall'utente. Un riferimento di tensione integrato facilita le considerazioni di design. Uno stabilizzatore di duty cycle è fornito per compensare le variazioni nel ciclo di lavoro dell'ADC, permettendo al convertitore di mantenere prestazioni eccellenti. È un prodotto usato in applicazioni come: comunicazioni, sistemi radio in diversità d'antenna, ricevitori digitali multimodali (3G), sistemi di demodulazione I/Q, TD-SCDMA, WiMax, WCDMA, CDMA2000, GSM, EDGE, LTE, sistemi smart antenna, radio software generiche, apparecchiature a ultrasuoni, applicazioni dati in broadband.

• Non linearità differenziale: ±0,75LSB max a (AVDD = 1,8V, DRVDD = 1,8V)
• Rapporto segnale-rumore: 72,6dBFS tipico a (fIN = 30MHz, AVDD = 1,8V, DRVDD = 1,8V)
• Larghezza di banda a piena potenza: 1000MHz tipica a (AVDD = 1,8V, DRVDD = 1,8V)
• Errore di offset: ±10mV max a (AVDD = 1,8V, DRVDD = 1,8V)
• Rumore riferito all'ingresso: 1,33LSB rms tipico a (AVDD = 1,8V, DRVDD = 1,8V)
• Range dinamico privo di spurie: 95dBc tipico a (fIN = 30MHz, AVDD = 1,8V, DRVDD = 1,8V)
• Tensioni di alimentazione: 1,8V, uscite LVDS (livelli ANSI-644)
• Frequenze di campionamento IF di fino a 400MHz, riferimento di tensione dell'ADC interno
• Stabilizzatore di ciclo di lavoro di clock dell'ADC, controllo di porta seriale, modalità di power-down a risparmio energetico
• Temperatura di esercizio: da -40°C a +85°C, package LFCSP-VQ a 64 piedini

Note

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