AD9542BCPZ

AD9542 è un doppio sincronizzatore DPLL e traslatore di clock adattivo a 4 ingressi e 5 uscite. Le 10 uscite di clock sono sincronizzate con uno qualsiasi dei riferimenti di ingresso in un numero fino a quattro. Gli anelli ad aggancio di fase digitali (DPLL) riducono il jitter di temporizzazione associato con i riferimenti esterni. L'anello digitalmente controllato e la circuiteria di holdover genera continuamente un segnale di uscita a basso jitter, anche quando falliscono tutti gli ingressi di riferimento. Le applicazioni tipiche sono: pulizia del jitter e sincronizzazione SyncE, Optical Transport Networks (OTN), SDH e stazioni base a macro e piccola cella, mappatura/demappatura di OTN con rimozione del jitter, clock di piccole stazioni base, compreso l'holdover di Stratum 2, Stratum 3ee Stratum 3 radio e di banda base, controllo dei transitori di fase e clean-up del jitter, supporto di JESD204B per il clock di convertitori analogico-digitali (ADC) e digitale-analogici (DAC), infrastrutture con cavi, carrier Ethernet.

• Il mux cross-point interconnette gli ingressi di riferimento con i PLL
• Supporta i segnali di clock di input/output embedded (modulati)
• Supporto di EEPROM esterna per l'inizializzazione autonoma
• Modalità di aggancio rapido con DPLL
• Supporto di EEPROM esterna per l'inizializzazione autonoma
• Configurazione di dissipazione di potenza tipica: 560mW (i valori tipici si applicano per VDD=1,8V)
• Pieno power-down tipico: 125mW (i valori tipici si applicano per VDD=1,8V)
• On/off riferimento di ingresso (single-ended): 13mW (fREF=19,44MHz)
• Range di frequenza di uscita: 2250-2415MHz
• Package LFCSP con 48 reofori, range di temperatura: da -40°C a +85°C

Note

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